pipeline architecture中文是什么意思

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管線結構

architecture n. 1.建筑學。 2.建筑(樣式、風格)；建筑物。 3 ...
architecture pipeline 管線結構
in the pipeline 在途中, 在進行中
pipeline 導管; 工藝過程; 供給系統; 管道，管線; 管道跨越; 管道流; 管道路; 管道系; 管路; 建設管線; 廉線; 匿名消息來源; 情報來源; 渠管; 商品供應線; 輸油管; 水管大作戰; 裝管道
pipeline in the 編審中
architecture n. 1.建筑學。 2.建筑(樣式、風格)；建筑物。 3.構造，結構；【自動化】(電子計算機的)架構，體系結構。 civil architecture 民用建筑。 domestic architecture 住宅建筑。 naval architecture 造船術，造船學。 the architecture of a beehive 蜂窩的結構。
compound pipeline complex pipeline 復合管道
active pipeline 活動流水線
alignment of pipeline 管道定線
arithmetic pipeline 運算流水線
array pipeline 數組流水線
auxiliary pipeline 輔助管線
backbone pipeline 干線
balancing pipeline 平衡水管
blood pipeline 血管; 血液管道
bonded pipeline 保稅快線
branch pipeline 支線管道
buried pipeline 埋設管道
chemical pipeline 化學品管線
circular pipeline 循環流水線
collector pipeline 集輸管線
commercial pipeline 商業用管線
cowshed pipeline 牛舍奶管
cream pipeline 奶油輸送管道
cross pipeline 穿越管線

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例句與用法

This paper introduces the history of the gpu firstly , and then it analyses the pipeline architecture of gpu . finally , it introduces several types of program languages of gpu
本文首先介紹了可編程圖形硬件的發展，然后分析了它的流水線結構，最后介紹了幾種最新的編程語言。
And it presents the method that the filter is analyze to lifting process . we use the folding and pipeline architecture to deal with this kind of novel dwt
本論文提出一種根據jpeg2000標準將9 7濾波器分解為提升過程矩陣乘積的形式，使用流水線的思想的新型離散小波變換結構。
After analyzing and comparing different partition rules , md32 pipeline architecture is finally defined , which meets the required instruction function , frequency and timing spec of md32 . a complete set of creative design method for risc / dsp md32 micro - architecture is presented , such as parallel design , internal pipeline , central control , etc . thanks to the adoption of these design methodology , control path and data path are separated , circuit delay is reduced , and complex instruction operations are balanced among multiple pipeline stages
它們將若干復雜指令操作均勻分配在幾個流水節拍內完成，實現了任意窗口尋址等復雜指令操作，將整個處理器的數據通路與控制通路分離，減小了電路時延，從而滿足了risc dsp不同指令功能和系統時鐘頻率的要求，構成了統一的、緊密聯系的、協調的md32系統結構。
The paper elaborates risc technology characteristic and 5 - stage pipeline architecture and function of the 64 - bit risc cpu , and dwells on 64 - bit vega cpu characteristic , and details the eda technology and the main flow of asic design , and elaborates the operation and exception process of the vega cpu and virtual instruction address " architecture and generation , and details cache architecture and mmu . the master dissertation dwells on virtual address translating into physical address , instruction cache finding address and instruction fetching , too
詳細的闡述了64位vegacpu的特點，闡述了eda技術和asic設計的主要流程，闡述了vegacpu流水線結構、流水線操作、流水線暫停和異常處理，虛擬指令地址的結構和產生， mmu結構，包括指令tlb結構和虛擬指令地址向物理指令地址的生成流程， cache結構，尋址原理和指令的寫策略，指令高速緩存的尋址原理和結構，以及指令的獲取流程。

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